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基于DE1-SOC FPGA开发板的音频采集和播放

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功能介绍

利用DE1-SOC平台,verilog语言编程实现,实现功能:

  1. wm8731工作模式配置为主模式,数字接口模式配置为24bits数据位宽、右对齐模式(主模式下一帧包含64个BCLK,左右声道各32个)侧音打开
  2. key2增加音量、key1减小音量(目前只控制linein的增益 )

软硬件环境

   

  • 软件平台:Quartusii18.1(下载、安装和破解教程)
  • 硬件环境:DE1-SOC开发板
  • 外设:按键、音频接口
  • 开发语言:Verilog

使用说明

  1. 信号说明
  1. 操作说明

key2增加音量、key1减小音量(目前只控制linein的增益 )

版权声明

      该代码为本站自研,拥有全部知识产权。

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百度网盘:https://pan.baidu.com/s/1Rs2zKQ3SYvj16tJ8wLba-w

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